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[资料] [视频教程] System Verilog - Quick Overview for Design Verification

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发表于 2016-12-20 22:49:07 | 显示全部楼层 |阅读模式
本帖最后由 soc_design 于 2016-12-20 23:13 编辑

This video lecture provides a quick concise overview about hardware verification environment and system verilog.
At many universities this topic is not covered but very useful for industry. This video may help you very much if you wanna get a verification engineer job.

时长:1:00:11

这个视频没有细看,大致翻了一下,讲到了sv很关键的一些概念,可作为入门材料。

链接: https://pan.baidu.com/s/1bpGaKDh
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发表于 2016-12-27 18:47:17 | 显示全部楼层
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发表于 2017-1-14 20:30:21 | 显示全部楼层
Very good book=)
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