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查看: 231|回复: 9

[资料] Synopsys DC-RM_O-2018.06

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发表于 2019-1-7 18:58:36 | 显示全部楼层 |阅读模式
Design Compiler Reference Methodology
. Design Compiler
. DC Explorer
. DFT Compiler/DFTMAX
. Power Compiler
. Formality
. VC LP

DC-RM_O-2018.06.tar

190 KB, 下载次数: 24, 下载积分: IC币 -5 元

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发表于 2019-1-8 09:09:36 | 显示全部楼层
资料还是软件呀。。
发表于 2019-1-8 09:43:25 | 显示全部楼层
这个是什么东西啊?
发表于 2019-1-9 00:58:25 | 显示全部楼层
Files Included With the Design Compiler Reference Methodology
=============================================================


------------------------------------------------------------------------------------
File                                        Description
------------------------------------------------------------------------------------
DC-RMsettings.txt                        Reference methodology option settings used to
                                        generate the scripts.


README.DC-RM.txt                        Information and instructions for setting up and
                                        running the Design Compiler Reference Methodology
                                        scripts.


Release_Notes.DC-RM.txt                 Release notes for the Design Compiler Reference
                                        Methodology scripts listing the incremental
                                        changes in each new version of the scripts.


rm_setup/common_setup.tcl               Common design setup variables for the reference
                                        methodologies.


rm_setup/dc_setup.tcl                   Library setup for the Design Compiler Reference
                                        Methodology, including the Formality, MVRC, and
                                        Verification Compiler Low Power Static scripts,
                                        and for RTL exploration in the DC Explorer
                                        compatible scripts.


rm_setup/dc_setup_filenames.tcl         File names setup for the Design Compiler Reference
                                        Methodology, including the Formality, MVRC, and
                                        Verification Compiler Low Power Static scripts, and
                                        for RTL exploration in the DC Explorer compatible
                                        scripts.




rm_dc_scripts/dc.tcl                    Design Compiler Reference Methodology script for
                                        top-down RTL exploration and synthesis or for
                                        block-level RTL exploration and synthesis in a
                                        hierarchical flow.


rm_dc_scripts/fm.tcl                    Formality script to verify top-down synthesis
                                        results or for block-level synthesis results in a
                                        hierarchical flow.


rm_dc_scripts/dc_top.tcl                Design Compiler Reference Methodology top-level
                                        integration script for hierarchical flow
                                        RTL exploration and synthesis.


                                        This file is included only if the reference
                                        methodology scripts are configured for a
                                        hierarchical flow.


rm_dc_scripts/fm_top.tcl                Formality top-level verification script for
                                        hierarchical flow synthesis.


                                        This file is included only if the reference
                                        methodology scripts are configured for a
                                        hierarchical flow.


rm_dc_scripts/golden.upf                Example of a golden UPF file for top-down
                                        multivoltage synthesis.


                                        This file is included only if the reference
                                        methodology scripts are configured for a
                                        multivoltage flow.


rm_dc_scripts/
dc.mcmm.scenarios.tcl                        Example of the Design Compiler Reference Methodology
                                        setup file for scenarios in a multicorner-
                                        multimode flow.


rm_dc_scripts/
dc.dft_autofix_config.tcl                Design Compiler Reference Methodology design
                                        example for test AutoFix configuration file.


rm_dc_scripts/
dc.dft_occ_config.tcl                        Design Compiler Reference Methodology
                                        design-for-test (DFT) on-chip clocking
                                        configuration file example.


                                        This file is included only when the reference
                                        methodology scripts are configured to include
                                        on-chip clocking in the DFT flow.


README.MVRC-RM.txt                      Information and instructions for setting up and
                                        running the MVRC Static Verification Reference
                                        Methodology scripts.


Release_Notes.MVRC-RM.txt               Release notes for the MVRC Static Verification
                                        Reference Methodology scripts listing the
                                        incremental changes in each new version of the
                                        scripts.


rm_dc_scripts/mvrc.tcl                  MVRC Static Verification Reference Methodology
                                        script used to perform static verification of
                                        multivoltage designs for top-down synthesis or
                                        for block-level synthesis in a hierarchical flow.


rm_dc_scripts/mvrc_top.tcl              MVRC Static Verification Reference Methodology
                                        script used to perform static verification of
                                        multivoltage designs at the full-chip level
                                        in a hierarchical flow.


README.VCLP-RM.txt                      Information and instructions for setting up and
                                        running the Verification Compiler Low Power Static
                                        Signoff Reference Methodology scripts.


Release_Notes.VCLP-RM.txt               Release notes for the Verification Compiler Low
                                        Power Static Signoff Reference Methodology scripts
                                        listing the incremental changes in each new
                                        version of the scripts.


rm_dc_scripts/vc_lp.tcl                 Verification Compiler Low Power Static Signoff
                                        Reference Methodology script used to perform static
                                        verification of multivoltage designs for top-down
                                        synthesis or for block-level synthesis in a
                                        hierarchical flow.


rm_dc_scripts/vc_lp_top.tcl             Verification Compiler Low Power Static Signoff
                                        Reference Methodology script used to perform
                                        static verification of multivoltage designs at the
                                        full-chip level in a hierarchical flow.


rm_dc_scripts/snpsll_hpdu_synth.tcl          The Tcl file with the dont_use list for
                                        Synopsys DesignWare logic libraries
------------------------------------------------------------------------------------


发表于 2019-1-9 07:48:43 | 显示全部楼层
好东西,感谢分享
发表于 2019-1-9 14:31:42 | 显示全部楼层
有用吗???能用吗?
发表于 2019-1-13 14:48:46 | 显示全部楼层
学习了,不错哦
发表于 2019-1-14 16:10:47 | 显示全部楼层
看看值得推荐,下载。
发表于 7 天前 | 显示全部楼层
本以为分享的是软件呢,结果是参考脚本。。。。
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